Diferencia entre revisiones de «Flip-flops»
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== Flip-Flop maestro-esclavo == | == Flip-Flop maestro-esclavo == | ||
<div align="justify">Un flip flop maestro-esclavo se construye con dos FF, uno sirve de maestro y otro de esclavo. Durante la subida del pulso de reloj se habilita el maestro y se deshabilita el esclavo. La información de entrada es transmitida hacia el FF maestro. Cuando el pulso baja nuevamente a cero se deshabilita el maestro lo cual evita que lo afecten las entradas externas y se habilita el esclavo. Entonces el esclavo pasa al el mismo estado del maestro. El comportamiento del flip-flop maestro-esclavo que acaba de describirse hace que los cambios de estado coincidan con la transición del flanco negativo del pulso. | <div align="justify">Un flip flop maestro-esclavo se construye con dos FF, uno sirve de maestro y otro de esclavo. Durante la subida del pulso de reloj se habilita el maestro y se deshabilita el esclavo. La información de entrada es transmitida hacia el FF maestro. Cuando el pulso baja nuevamente a cero se deshabilita el maestro lo cual evita que lo afecten las entradas externas y se habilita el esclavo. Entonces el esclavo pasa al el mismo estado del maestro. El comportamiento del flip-flop maestro-esclavo que acaba de describirse hace que los cambios de estado coincidan con la transición del flanco negativo del pulso. | ||
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== Flip-Flop disparado por flanco == | == Flip-Flop disparado por flanco == | ||
Revisión del 13:45 4 jun 2011
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Sumario
Flip-Flop maestro-esclavo
Flip-Flop disparado por flanco
pulso de reloj es el flip flop disparado por flanco. Cuando la entrada de reloj excede un nivel de umbral especifico ( threshold level), las entradas son aseguradas y el FF no se ve afectado por cambios adicionales en las entradas hasta tanto el pulso de reloj no llegue a cero y se presente otro pulso.
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Algunos FF cambian de estado en la subida del pulso de reloj, y otros en el flanco de bajada. Los primeros se denominaran Flip flop disparados por flanco positivo y los segundos Flip flops disparados por flanco negativo. La distinción entre unos y otros se indicará con la presencia o ausencia de una negación en la entrada de reloj como se muestra en la figura.
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Parámetro de los Flip-Flops
Además de los parámetros característicos de la familia lógica a que pertenecen, como son niveles lógicos, fan-out., étc. Cabe destacar una serie de parámetros, más o menos normalizados, relativos a la temporización de las diferentes señales que intervienen en la conmutación de los flip-flops. De ellos cabe destacar los siguientes: Tiempo de establecimiento (SET UP TIME). Es el tiempo anterior al flanco activo de toma de datos durante el cual las entradas no deben cambiar. Tiempo de mantenimiento (HOLD TIME). Es el tiempo posterior al flanco activo de toma de datos durante el cual las entradas no deben cambiar. Frecuencia máxima de reloj. Es la frecuencia máxima admisible de la señal de reloj que garantiza el fabricante. Duración del tiempo alto de reloj. Es el tiempo mínimo que debe durar la parte alta del impulso de reloj. Duración del tiempo bajo de reloj. Es el tiempo mínimo que debe durar la parte baja del impulso de reloj. Tiempo bajo de PRESET Y CLEAR. Es el tiempo mínimo que debe activarse las entradas asíncronas para garantizar su funcionamiento. Tiempo de retardo o propagación.Es el tiempo que transcurre desde el flanco activo del reloj que produce la conmutación y el momento en que ésta tiene lugar.
Fuente
- http://www.espaciodelconocimiento.com/
- Pollán Santamaría, Tomás. Electrónica Digital. Departamento de Ingeniería Electrónica y Comunicaciones. Universidad de Zaragoza. 2007.
- Telles, Luis y Pino Pupo, Ezequiel, Elementos Básicos de Electrónica Digital y Microprocesadores. Internet.
- J. Millman and A. Grabel. Microelectronics. McGraw-Hill Electrical and Electronics Series. 1987.
- Ronald J. Tocci. Sistemas Digitales. Principios y Aplicaciones. Prentice-Hall Hispanoamericana, S.A. 1993. ISBN: 968-880-219-0.
- M..Morris Mano. Diseño Digital. Prentice-Hall Hispanoamericana, S.A. 1992. ISBN: 968-880-106-2.
- John F. Warkerly. Diseño Digital. Principios y Prácticas. Prentice-Hall Hispanoamericana, S.A. 1992. ISBN: 968-880-244-1.